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主題:電子技術資料:Cadence 發(fā)布創(chuàng)新FPGA-PCB協(xié)同設計方案實現(xiàn)方案

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電子技術資料:Cadence 發(fā)布創(chuàng)新FPGA-PCB協(xié)同設計方案實現(xiàn)方案  發(fā)帖心情 Post By:2010-12-8 11:18:50

全球電子設計方案創(chuàng)新領先企業(yè)cadence 設計方案系統(tǒng)公司nasdaq:cdns今天發(fā)布了一款創(chuàng)新,可擴展協(xié)同設計方案實現(xiàn)方案,應用印制電路板pcb系統(tǒng)fpga設計方案。cadence? orcad?與 allegro? fpga system planner系統(tǒng)可縮減當今復雜fpgas協(xié)同設計方案時間——那些具有大量引腳數(shù)目,bank與引腳分配規(guī)則精細化——同時通過發(fā)布具有自動化fpga引腳位置感知,i/o分配綜合來減少風險。
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  由taray公司研發(fā),cadencer客戶可通過原始設備供應商oem協(xié)議獲得,這一獨一無二聯(lián)合實現(xiàn)方案供應了提升correct-by-constructionfpga引腳分配,它可使pcb布線過程中減少引腳提升迭代次數(shù),同時減少將fpga合并pcb設計方案所需層數(shù)。allegro fpga system planner通過fpga引腳自動分配,還縮短了公司使用fpga在pcb系統(tǒng)上模擬asic時間。
  “我嘗試了其它承諾簡化fpga i/o復雜性難題工具,但沒有一個有象taray公司這樣完成方法,”harris公司gcsd信號完整tmt負責人roberto cordero說道,“taray公司fpga i/o綜合技術信息是惟一一個能能讓我們在系統(tǒng)級輸入我們設計方案意圖,它完全自動將引腳分配一次合并到多個fpga中。taray公司技術信息將成為cadence公司產(chǎn)品一個強有力組合。”
  對于日益增長數(shù)據(jù)吞吐量對及越來越多功能,其產(chǎn)品導致大量引腳數(shù)fpga具有具有高速io需求。這些fpgas還具有更高級存儲器接口,更低功耗,從而完成客戶對研發(fā)更加“綠色”產(chǎn)品需。運用這種更大容量,更多功能與先進高速接口fpga,在pcb系統(tǒng)中,對及在pcb上運用fpga進行asic.模擬數(shù)目正在增加。 cadence公司orcad與allegro fpga system planner面向那些將fpga應用pcb系統(tǒng)而面對挑戰(zhàn)系統(tǒng)公司與ic公司。
  “現(xiàn)成多fpga原型板并不總是能足夠設計方案師條件,”xilinx公司硅硬件及使用資深總監(jiān)ed mcgettigan說道,“運用這種fpga i/o綜合技術信息,設計方案者可創(chuàng)造出一個新原型系統(tǒng),同時比運用基準引腳提升手工方法快得多時間找出幾種互聯(lián)及組件設計方案方法。”
  該技術信息在一一系列可擴展實現(xiàn)方案中均可獲得,從orcad fpga system planner到allegro fpga system planner l, xl 對及gxl,并及orcad capture, orcad pcb designer,allegro design entry hdl 與 allegro pcb design產(chǎn)品緊密合并。fpga system planner縮減了將fpga合并到pcb時間,通過fpga資源最佳化運用,增強了fpga性能,并通過減少密集布局,復雜與大量引腳數(shù) fpga所需pcb層數(shù)從而減少了pcb生產(chǎn)成本。
  “cadence 公司fpga system planner一個創(chuàng)新實現(xiàn)方案,面向那些面對將現(xiàn)今大量引腳數(shù)目,復雜fpga合并到pcb設計方案過程挑戰(zhàn)設計方案團隊”cadence公司副總栽charlie giorgetti,說道,“這正是我們客戶期待從我們這里獲得能夠縮短pcb上有大量引腳數(shù)目fpga設計方案周期并減少管理風險那種技術信息,自動化與創(chuàng)新。

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